Semiconductor Devices

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第三章：双极型晶体管 §3.1 基本原理 §3.2 IV特性 §3.3 晶体管模型 §3.4 频率特性 §3.5 功率特性 §3.6 开关特性 §3.7 晶体管的设计 §3.8 异质结晶体管HBT Semiconductor Devices 2019/1/12

简介晶体管（晶体三极管，三极管）： Transistor 双极型晶体管：Bipolar Junction Transistor 双极型器件是由电子和空穴两种载流子都参与导电的半导体器件，因此称为双极型。从P-N结理论的讨论中已知电流输运是由电子和空穴两种载流子组成的，故由P-N结组成的晶体管又称作双极晶体管。双极晶体管是最重要的半导体器件之一。 1947年由贝尔实验室的一个研究小组发明。 Semiconductor Devices 2019/1/12

双极型晶体管 The ”Planar Process” developed by Fairchild in the late 50s shaped the basic structure of the BJT, even up to the present day. Semiconductor Devices 2019/1/12

§3.1 晶体管的基本原理 1、基本结构及其杂质分布基本结构由两个P-N结共用一个基区组成的。在两个结中，一个叫发射结，一个叫集电结。中间区域就叫基区，而另两个区与结相对应的被称作发射区和集电区。器件具有三个电极端子，分别称作发射极，基极和集电极。 Semiconductor Devices 2019/1/12

双极型晶体管类型 n+ p n p+ n p Semiconductor Devices 2019/1/12

晶体管工艺与杂质分布 (a)合金管杂质分布特点：三个区内杂质均匀分布，发射结、集电结为突变结 . (b)双扩散管杂质分布特点：基区为缓变杂质分布，发射区杂质分布也缓变。 (c) 全离子注入管杂质分布特点：三个区内杂质均匀分布，发射结、集电结为突变结 Semiconductor Devices 2019/1/12

分类晶体管内部，载流子在基区的传输过程是决定晶体管的增益、频率特性等性能参数的重要指标。在基区宽度确定后，基区杂质分布是影响基区输运过程的关键因素，一般可以分为两大类： (a)均匀基区晶体管，传输机构以扩散为主，如合金管和全离子注入管。传输以扩散为主。 (b)缓变基区晶体管。如各种扩散管。由于基区中存在自建电场，以漂移为主， Semiconductor Devices 2019/1/12

(a) (b) (c) NPN晶体管共基极(a)、共发射极（b）和共集电极（c）的三种连接法 Semiconductor Devices
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2、晶体管的放大原理以均匀基区P-N-P晶体管为例分析其基本物理图象：内部载流子的运动。电压增益：功率增益： Semiconductor Devices 2019/1/12

P-N-P均匀基区晶体管的物理结构、杂质分布、电场分布和平衡态能带图 Semiconductor Devices 2019/1/12

P-N-P均匀基区晶体管正常偏置条件下的物理结构、杂质分布、电场分布和能带图 Semiconductor Devices 2019/1/12

3、晶体管端电流的组成工作在放大状态下pnp晶体管的各个电流分量为： IEP：从发射区注入的空穴电流， IEN：从基区注入到发射区的电子电流， ICN：集电区－基区结附近的热电子漂移到基区形成的电流， ICP：集电区－基区结的空穴注入电流。 IBR＝IEP－ICP，基区内电子与空穴电流的复合而必须补充的电子电流。 Semiconductor Devices 2019/1/12

PNP晶体管电流组成 IE=IEp+IEn IC=ICp+ICn IB=IE-IC=IEn+(IEp-ICp)-ICn Semiconductor Devices 2019/1/12

NPN晶体管电流组成 emitter current injected into the base
base current injected into the emitter recombination in the base current region reverse biased current across the BCJ electron current from the emitter Semiconductor Devices 2019/1/12

4、晶体管的电流增益直流共基极电流放大系数（或电流增益）的定义为其中，发射效率：基区传输因子 Semiconductor Devices 2019/1/12

集电极电流表达式：下标CB: 表示C和B结的端电流 O: 表示对应的第三端与第二端之间为开态 Semiconductor Devices 2019/1/12

共发射极晶体管的电流放大系数（电流增益）为电路应用中，晶体管的共射级组态最常用，即发射极作为公共端，基极和集电极为输入和输出端。 Semiconductor Devices 2019/1/12

共射级晶体管放大 IB IC IE Semiconductor Devices 2019/1/12

5、提高电流增益的一般原则晶体管的电流传输作用是晶体管具有放大能力的基础，晶体管具有放大作用需要满足下列条件，内部：发射结与集电结要相距很近，即WB<<LB。外部：发射结正偏，集电结反偏，这样才会有电流传输过程，即晶体管工作在有源放大区。晶体管的作用是将发射极电流最大限度地传输到集电极。为提高α0，要尽可能减小输运过程中的损失。主要方法有：（1）减小基区向发射区的反向注入空穴电流（或电子电流）NPN管（或PNP管），即提高发射效率γ。（2）减小基区体内的复合电流IBB，即提高基区传输因子αT。 Semiconductor Devices 2019/1/12

提高电流增益的主要措施有：提高发射区掺杂浓度或杂质总量，增大正向注入电流，减小基区宽度，提高基区杂质分布梯度，提高基区载流子寿命和迁移率，以增大载流子的扩散长度。 Semiconductor Devices 2019/1/12

§3.2 IV特性 1、均匀基区理想晶体管为了简便起见，推导过程包含了如下基本假设： ①发射区、基区和集电区的杂质分布均为均匀分布，且两结皆为突变结。 ②小注入条件满足。即注入到基区的少子浓度远低于该区多子浓度。 ③势垒区宽度远小于扩散长度，忽略耗尽区内的产生一复合作用，通过势垒区的电流为常数。 ④器件中不存在串联电阻，晶体管三个中性区的电导率均足够高，使得外加电压全部降落在势垒区中，势垒区以外无电场。 ⑤器件的一维性。使载流子只沿x方向作一维运动，忽略了表面复合等影响，且发射结和集电结两结面积相同且互相平行。 ⑥发射区宽度WE和集电区宽度WC都远大于少子扩散长度，在两端处的少子浓度等于平衡时值。 Semiconductor Devices 2019/1/12

由理想模型可以求解各区中的少子连续性方程，得出各区的少子浓度分布和电流密度分布。最后求出发射极电流IE，集电极电流IC与偏压VEB和VCB的函数关系。根据基本物理模型，可以写出稳态下的一维的电流密度方程和连续性方程如下： Semiconductor Devices 2019/1/12

中性基区少子分布的表达式为基区少子分布遵循双曲函数规律变化。它之所以不再是单个P-N结那样的简单指数分布函数，原因就在于离发射结很近的地方有集电结存在，从而改变了边界条件。 Semiconductor Devices 2019/1/12

对实际晶体管，基区宽度WB远小于少子扩散长度LpB，对上式中的双曲函数取一级近似：此时，基区少子分布可以近似为线性分布。 Semiconductor Devices 2019/1/12

放大状态下的载流子分布示意图 Semiconductor Devices 2019/1/12

由此，基区连续性方程为基区少子浓度的边界条件基区少子的分布 Semiconductor Devices 2019/1/12

通过发射结注入的空穴电流密度为到达集电结的空穴电流密度为 Semiconductor Devices 2019/1/12

发射区连续性方程为发射区少子浓度的边界条件发射区少子的分布通过发射结的电子电流密度为 Semiconductor Devices 2019/1/12

类似地，集电区连续性方程为集电区少子浓度的边界条件集电区少子的分布通过集电结的电子电流密度为 Semiconductor Devices 2019/1/12

PNP管各区的少子分布图 Semiconductor Devices 2019/1/12

基区过剩载流子存贮电荷当pn(x)>>pn0时即阴影部分面积 Semiconductor Devices 2019/1/12

理想晶体管的IV特性方程均匀基区P-N-P晶体管电流一电压方程： Semiconductor Devices 2019/1/12

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由基区内总的少子存贮电荷可得集电极电流的另一表达式： Semiconductor Devices 2019/1/12

讨论晶体管三个极的电流和基区内的少子分布有关，理想晶体管的基本关系式为：外加电压通过eqV/kT控制边界上的载流子浓度；发射极和集电极电流由边界处的少子浓度梯度给出，这两个电流和基区存贮电荷成正比； P-N-P晶体管的发射效率基区传输因子 Semiconductor Devices 2019/1/12

2、晶体管的工作状态晶体管的工作状态取决于发射结、集电结上所加的电压极性。放大状态：VEB正偏，VCB反偏；饱和状态：VEB正偏，VCB正偏；截止状态：VEB反偏，VCB反偏；反转状态：VEB反偏，VCB正偏；饱和状态时，晶体管处于小偏置电压、大输出电流情况，即导通状态。截止状态时，基区内无存贮电荷，集电极电流接近0，即关断状态。反转状态时，电流增益小于放大状态，因为集电极掺杂浓度比基极浓度要低，因此发射效率也较低。 Semiconductor Devices 2019/1/12

工作模式： VCB Saturation Forward active Cutoff Inverted active VEB PNP NPN VBC VBE E-B C-B 状态正偏正偏反偏放大反偏反转正偏饱和截止反偏 Semiconductor Devices 2019/1/12

3、静态特性的修正（1）缓变基区晶体管热平衡下，中性基区内将存在一个自建电场来抵消由于基区杂质浓度梯度分布而引起的扩散电流。在放大偏置状态下，所注入的少子不仅有扩散运动，还有由基区内建电场引起的漂移运动。内建电场的主要作用是减少注入少子渡越基区所需的时间，从而改善晶体管的高频特性。还可以减小少子在基区的复合，从而改善基区的传输因子。 Semiconductor Devices 2019/1/12

基区内建电场的表达式基区中自建电场对电流的贡献，平衡时，基区内多子电流为零。即 Semiconductor Devices 2019/1/12

双扩散管中，基区杂质分布一般满足高斯分布或余误差分布，都可以近似为指数分布。即：其中，是由基区两边的杂质浓度比值决定的一个常数，称其为场因子。基区内建电场的表达式为：式中负号表示自建电场方向与x方向相反。 Semiconductor Devices 2019/1/12

基区中少子分布与电场因子有密切关系，=0相当于均匀基区，越大，基区电场越强。基区中大部分区域的少子浓度梯度较小，只有在近集电结处少子浓度梯度才增大。 Semiconductor Devices 2019/1/12

推导缓变基区的少子分布和各区少子电流时有两种方法：（1）求解包括漂移分量在内的少子连续性方程，得到少子分布和少子电流分布从而导出缓变基区晶体管的I-V方程，这种方法精确，但过程繁杂。（2）忽略少子在基区输运过程中的复合损失，认为基区少子电流近似为常数（WB<<LpB），这种近似方法广泛采用。利用近似方法，代入基区少子电流表达式，可得： Semiconductor Devices 2019/1/12

忽略基区复合，设少子扩散系数为常数，及放大状态下，pn(W)=0，可得小注入条件下基区少子分布和少子电流的表达式：上面两式中的积分代表单位面积基区的杂质总量，称为古麦尔数(Gummel)，即 Semiconductor Devices 2019/1/12

同理可求出发射区的少子电流（发射区中杂质分布也是缓变的）：发射区的古麦尔数对于集电区，仍为均匀掺杂，与理想晶体管的结果相同： Semiconductor Devices 2019/1/12

缓变基区PNP晶体管I一V方程： Semiconductor Devices 2019/1/12

对于均匀掺杂基区，只要在理想晶体管推导出的I－V公式中，以QG代替WBNB，即可从均匀基区过渡到缓变基区的情形。 Semiconductor Devices 2019/1/12

缓变基区对直流电流增益的影响（1）注入效率（2）基区输运系数 η→0时，λ=2，对应均匀基区 Semiconductor Devices 2019/1/12

（2）基区扩展电阻为获得高的电流增益，基区宽度必须窄，因此基区电阻可能较高，基区与发射极有两个接触，称为双基极条，电子流向发射区中心。发射区的正下方与结面平行，与之相应的电阻为基区扩展电阻：rbb/，其上的横向电压为由于晶体管中存在着基区扩展电阻，因此当基极电流流过时，就会在基区中产生横向压降，从而使实际加在E、B结上的正向偏压从基极电极到结接触面逐渐减小，使注入电流密度从边缘至中央指数下降。 Semiconductor Devices 2019/1/12

发射极电流集边效应由于基区扩展电阻效应使发射结中心部分的电流密度大大降低，发射极电流主要集中在发射极的边缘部分，这种现象称为发射极电流集边效应由于发射极电流集边效应，发射极电流基本上同发射区的周长成正比，而不是同它的面积成正比。所以，降低发射极电流集边效应最有效的方法是使电流分布在一个相当大的边缘上，如采用周长/面积比很高的梳状结构。 Semiconductor Devices 2019/1/12

LE/AE Semiconductor Devices 2019/1/12

（3）Early效应（基区宽度调制效应）当改变基极－集电极偏压时，集电结耗尽区宽度随之改变，因而也引起中性基区宽度WB的变化，这种现象称为基区宽度调制，也称Early效应。对合金管，集电结为单边突变结，基区掺杂最低，势垒区完全扩展在基区内。对双扩散管，集电区掺杂小于基区掺杂，扩展集中在集电区内。定义厄尔利电压 Semiconductor Devices 2019/1/12

基区掺杂越低，越大，VA也越小，Early效应越显著；VA越大，基区宽度调制效应的影响越小，理想情况下，VA→∞。对均匀基区：对缓变基区： WB0表示xB＝0时的基区宽度 Semiconductor Devices 2019/1/12

基区宽度调制影响器件特性的表现之一是集电极电流随偏压变化。共射极接法的集电极电流：一个很小的基极电流可以引起很大的集电极电流。理论上，当VEC>0时，对给定的基极电流IB，集电极电流IC不依赖于VEC。但实际上，IC随VEC的增加而增加。这种集电极电流不饱和现象可以用厄尔利效应来解释。当VEC增加时，基区宽度W减小，导致β0增加，故IC增大。 Semiconductor Devices 2019/1/12

Early effect: impact of VBC on WB VBC 越负，注意: Semiconductor Devices 2019/1/12

利用共发射极输出特性曲线的切线来确定VA: Semiconductor Devices 2019/1/12

（4）Kirk效应（基区展宽效应）在大电流密度工作下的晶体管基区将会发生扩展，这一现象是柯克于1962年首先提出来的，所以也被称为柯克效应。由于现代大功率晶体管都是用扩散工艺制造，所以下面的讨论都是针对缓变基区晶体管的。在放大工作状态下，理想晶体管假定边界处的少子浓度为0，但实际上存在少子浓度。空穴浓度在中性基区内被多子电子中和，但在耗尽区内将改变正负电荷层的浓度。若维持集电结偏压不变，则负电荷层减小，正电荷层宽度增加，整个耗尽区向衬底移动，中性基区趋于加宽。一定条件下，中性基区宽度超过扩散时形成的原始基区宽度，这种现象称为基区展宽效应（Kirk效应） Semiconductor Devices 2019/1/12

（5）产生复合电流和大注入效应（a）基区电导调制效应以PNP晶体管为例：由基区电中性要求，基区中多子与少子分布相同，即满足：dnB(x)/dx=dpB(x)/dx和 nB(0)=nB0+pB(0）基区多子（电子）浓度可以用下式表示：考虑到基区大注入的少子对多子分布带来的影响后，基区电导率为 Semiconductor Devices 2019/1/12

若只考虑基区靠近发射结附近的电导率可近似为：对应电阻率为：式中的pB(0)/NB称为注入比。随着注入的加大，pB(0)不断加大，基区电导率B’相应地不断上升，电阻率不断下降。这一现象被称为基区电导调制效应。 Semiconductor Devices 2019/1/12

（b）产生复合电流实际晶体管在反向偏压下，集电区－基区内耗尽层存在产生电流，而发射区－基区正偏，耗尽层内有复合电流。如果产生电流在ICBO中起支配作用，对突变的集电结，ICBO随增加，对线性缓变的集电结，ICBO随增加，同时也增加。在小电流下，复合电流占支配作用， m≈2。 IC是由注入基区的空穴扩散到集电区形成的空穴电流，不受发射区－基区的复合电流影响。 Semiconductor Devices 2019/1/12

大注入时，由于电子（多子）浓度梯度的存在，必定会向集电结方向扩散，集电结上加的是反向偏压，它阻止电子流向集电区，因此在集电结的基区侧有电子积累，由于扩散运动，在发射结的基区侧电子浓度将降低，从而在基区中产生由发射结指向集电结的电场B，这一自建电场称为大注入自建电场。它同时改变了基区少子分布。基区电子和空穴的电流方程应为： Semiconductor Devices 2019/1/12

式中等号右边第一项为大注入引起的自建电场形成的漂移电流，第二项为浓度梯度引起的扩散电流。自建电场阻止多子（电子）的扩散，即InB =0 式中，EB为基区本身掺杂分布形成的内建电场 Semiconductor Devices 2019/1/12

（6）饱和电流和击穿电压（a）饱和电流当发射极开路时，集电极一基极结的反向电流定义为ICBO。当基极开路时，集电极-发射极结的反向电流定义为ICEO。通常， ICBO< ICEO， ICBO< 发射结短路时的电流IC。 Semiconductor Devices 2019/1/12

（b）击穿电压放大状态下，当VBC（共基极接法）或VEC（共射极接法）超过击穿电压临界值时，晶体管的集电极电流IC急剧增加，称为雪崩击穿。原因是集电结耗尽区内的电场太强而产生大量电子空穴（雪崩倍增）。共基极接法：定义发射极开路时集电极一基极击穿电压为BVCBO ，对集电区掺杂远低于基区时：式中，EC是临界击穿电场，NC是集电区的掺杂浓度 Semiconductor Devices 2019/1/12

共射极接法：定义基极开路时集电极一发射极的击穿电压为BVCEO，当外加电压较高以至集电结发生雪崩倍增效应，利用PN雪崩倍增因子的经验公式：可得：对于Si，n＝2～6，且β0较大，因此BVCEO<<BVCBO Semiconductor Devices 2019/1/12

随着集电结反向电压的增加，集电结势垒区向两边扩展，基区有效宽度WBeff减小。如果晶体管的基区掺杂浓度比集电区低，基区宽度WB又较小，则有可能在集电结发生雪崩击穿之前，WBeff减小到零，即发射区到集电区之间只有空间电荷区而无中性的基区，这种现象称为基区穿通。发生基区穿通时的集电极电压称穿通电压VPT，在VPT下，集电极电流将迅速上升。显然，基区较薄的合金结晶体管容易出现基区穿通效应，或者发生在集电区掺杂浓度高于基区的晶体管中。 Semiconductor Devices 2019/1/12

假设基区、集电区均匀掺杂，根据势垒宽度的公式，有对于给定的基区宽度WB，只有当NB较大时才能防止基区穿通，使器件的电压只受集电结耗尽区的雪崩倍增作用限制。（NC<<NB,基区较薄WB很小时）（NC>>NB时，容易发生基区穿通）式中NB为基区掺杂浓度, WB为基区宽度。 Semiconductor Devices 2019/1/12

4、输入和输出特性曲线晶体管应用在电路中可以有三种连接方式。这三种连接方式中应用最广的是共发射极连接，因为它具有大的电流增益和功率增益，电流增益定义为：而共基极连接具有更高些的截止频率。共集电极连接运用很少。故在此主要讨论共基极和共发射两种连接。 Semiconductor Devices 2019/1/12

(a) (b) (c) NPN晶体管(a)共基极、（b）共发射极和（c）共集电极三种连接法 Semiconductor Devices
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NPN晶体管共基极输入输出特性输入特性：IE随VBE指数上升，与正向P-N结特性一致，随着VCB增加，IE随VBE而上升得更快，这是由于基区宽度WB随VCB增加而减小，从而导致IE增大。输出特性：IE=0时IC=ICBO，即集电结反向饱和电流。IC按IE的规律随IE而增加，若IE一定，IC基本上不随VCB变化，在VCB下降到0以后IC才逐步下降到0，这是由于只有当集电结处于正偏状态后，才能阻止由发射区注入基区的空穴流向集电区。此时，晶体管进入饱和区。 Semiconductor Devices 2019/1/12

NPN晶体管共基极接法输出特性曲线 Semiconductor Devices 2019/1/12

NPN晶体管共发射极输入输出特性输入特性：与正向P-N结特性一致，随着VCE增加，IB减小。这是由于增加VCE会使WB减小，基区中的复合电流减小，从而使IB减小；至于VBE=0时，IB不为0，这是由于此时VCB≠0，集电结有ICBO流过，使IB=－ICBO。输出特性：当IB=0时，流过晶体管的电流为ICEO，随着IB增加，IC以βIB的规律上升；且随着VCE增加IC略上升，这是由于Early效应（WB减小而使β增大）的结果；当VCE减小到一定值（对硅管来说，该值约为0.7V）而使集电结转为正偏后，IC迅速下降，此时，晶体管进入饱和区。 Semiconductor Devices 2019/1/12

NPN晶体管共发射极接法输出特性曲线 Semiconductor Devices 2019/1/12

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§3.3 晶体管模型晶体管内部物理过程非常复杂，而在电路应用中，只需要关心器件的端特性。如果用一些基本的元件构造一个端网络，与晶体管的端网络相同，称为晶体管的等效电路或模型。因此在不同的应用场合可以有不同的模型。从构造途径划分可以分为两类： (1)由器件物理分析给出，称为物理模型，其物理意义明确，反映了器件内部的物理过程； (2)从应用角度出发，将器件视为“黑匣子”，不管其内部发生的过程，仅根据器件的端特性来构造模型，称为电路模型，这类模型的参数也可以与晶体管的内部参数联系起来。 Semiconductor Devices 2019/1/12

多年来，在SPICE之类的电路模拟器中，概括双极型晶体管的电学特性模型主要有E－M模型(J.J.Ebers-J.L.Moll)和G－P模型（Gummel-Poon）。其中E－M模型使器件的电学特性和器件的工艺参数相联系。而G－P模型则是建立在器件电学特性和基区多子电荷相联系的基础之上的。 Semiconductor Devices 2019/1/12

1．物理模型为了模拟双极晶体管的特性，可以使用各种模拟工具对电子、空穴分布、电场、电流等进行物理计算。一维模型在许多情况下有效，但是电流集边效应、边缘泄漏特性、发射极周边电容等，从本质上讲要用两维或三维模型来分析。对于硅基器件，通常用基于扩散－漂移输运机制的计算公式就足够了，但在计算一些与尺寸有关的特性时这些公式不再精确。对于Ⅲ－Ⅴ族HBT，上述输运机制的模拟精度会进一步受到影响。使用蒙特卡罗模拟是比较精确的，但是需要大量的计算。因而引入了流体动力学或能量平衡模拟，模拟的精度较差但计算较简单。 Semiconductor Devices 2019/1/12

埃伯斯－莫尔模型（EM模型）是1954年由J.J.Ebers和J.L.Moll首先提出的，属于晶体管的物理模型，其模型参数能较好反映物理本质且易于测量。基本思想是晶体管可以认为是基于正向的二极管和基于反向的二极管的叠加。 IF0为正偏时二极管的饱和电流 IR0为反偏时二极管的饱和电流 Semiconductor Devices 2019/1/12

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由上面两式可得，式中IEBO和ICBO分别为集电极开路时发射极饱和电流和发射极开路时的集电极饱和电流。 Semiconductor Devices 2019/1/12

为了改善模型的精确度，在基本模型基础上加串联电阻和耗尽层电容的改进模型。 Ebers-Moll Model Semiconductor Devices 2019/1/12

还可以考虑在内部发射极和集电极两端之间加上额外的电流源来包括厄而利效应。还可以在基极引线上加上二极管以解释沿基极－发射极结的两维电流拥挤效应。总结：器件模型越精确，所需模型参数就越多，器件模型就越复杂。 Semiconductor Devices 2019/1/12

2．电路级的模型 Gummel－Poon模型(G－P模型)的主要特点是把晶体管的电学特性（结电压、集电极电流等）和基区多子电荷联系在一起。其中QB0为热平衡时基区的多子电荷总量。QjE代表发射结正偏时其耗尽区宽度变化而使基区多子电荷增加的数量，QjC代表集电结正偏时其耗尽区宽度变化而使基区多子电荷增加的数量，QdE＋QdC代表基区中存储电荷的数量。具体的计算见课本《半导体器件物理基础》P83。 Semiconductor Devices 2019/1/12

Gummel-Poon Model ( ) Semiconductor Devices 2019/1/12

Gummel－Poon模型的讨论 ①不能很好描述电流集边效应。电流集边效应对硅双极晶体管是重要的问题，而对大多数HBT而言，因为HBT的基区掺杂通常较大，则可忽略。为了部分的考虑这些效应，SPICE模型提供一个表达式来描述基区电阻随正向电流的变化。 ②不能很好描述电荷贮存效应和集电区在饱和时的电阻，特别是对于承受中等偏压、具有较厚和轻掺杂集电区的晶体管。当晶体管工作在VBC较低的情形下，集电区没有耗尽，串联电阻显著增大。然而，如果VBC正偏且足够大时，注入到集电区的空穴使电阻减小。 ③用电荷控制模型描述晶体管的瞬态行为，只能是一种近似。特别是，瞬态电荷的分布与由电荷控制模型得到的稳态分布是不同的，至少非静态电荷分布会导致输出电流相对于输入偏压在时间上有所延迟。通常将时间延迟因子纳入到集电极电流源中，以用来校正已经包括在电荷控制模型中被称作延迟相位的延迟量。 Semiconductor Devices 2019/1/12

④为了精确描述晶体管的基区电阻和集电结电容，需要使用分布电阻－电容网络。为简化起见，Gummel－Poon模型只考虑了单一的基极电阻，器件的大部分电容必须通过该电阻进行充电，而在更精确的模型中，基区被分成几部分，分别定义了不同的串联电阻和相关的电容。 ⑤双极晶体管中的电流密度可能会很大，这样电流流过器件时会产生很可观的热量，由于晶体管的各种特性强烈依赖于温度的变化，自加热效应将对测量的特性产生影响。这对于Ⅲ－Ⅴ族器件尤为重要，因这种器件基区的电阻率高从而要求的发射区宽度也大。而且Ⅲ－Ⅴ族材料的导热率比硅低。为了计及自加热效应，可以考虑附加一个与晶体管有关的热电路。 ⑥ 考虑串联电阻等影响后，模型可以十分精确，但所需参数多达25个。为了对特定电路进行分析，必须在精确度和模型复杂性之间进行折衷考虑。 Semiconductor Devices 2019/1/12

§3.4 频率特性晶体管在实际应用中大都是用来放大交流讯号，特别是随着现代电子技术的发展，越来越多地被用于高频、超高频和微波领域，但当信号频率升高时，晶体管的放大特性要发生变化，如电流增益减小，相移增加等，这些变化的主要原因是势垒区电容及扩散电容的充放电。 1．频率参数 2．晶体管的小信号等效电路 3. 频率－功率限制 Semiconductor Devices 2019/1/12

（1）频率参数在低频工作时，电流增益不随频率变化。但工作在高频时，电流增益明显下降，且随着频率的增高, 电流增益一直降下去，直到器件失去放大能力。为了描述增益随频率变化的限制，引入下列电流增益的频率特征参数。共基极截止频率f：定义为当电流增益随频率升高而下降到低频增益的1/ 倍时所对应的频率，即下降到1/ 0时频率。共发射极截止频率f：定义为下降到1/ 0时的频率。特征频率fT：定义为下降到1时（0db）的频率。 Semiconductor Devices 2019/1/12

值得注意的是，f f以后，随频率升高而下降是有规律的：频率升高一倍，增益就下降一倍，即下降6db，其频率与增益的乘积保持为常数不变。 fT就是增益一带宽乘积，fT也是描述晶体管能起电流放大作用的最高极限频率。晶体管频率响应的最重要限制是少子通过基区的渡越时间。 Semiconductor Devices 2019/1/12

基区渡越时间当基区少数载流子pB(x)以速度v(x)穿越基区，产生基区传输电流IpB(x)=AqpB(x)v(x)时，v(x)为基区少子的有效速度，以PNP管为例，则空穴穿越基区的时间为在基区宽度WBLpB，近似认为基区传输电流为常数即IpB(x)IpE=-AJpE时，基区少子分布用均匀基区和线性近似代入可得 Semiconductor Devices 2019/1/12

（2）晶体管的小信号等效电路晶体管是非线性器件，但对于小信号条件下的工作状态可以看作线性器件。因此，常用四端网络的等效电路来研究晶体管电学特性。随着运用频率的提高，晶体管的各种电容效应开始起支配作用，故必须考虑势垒电容CTe、CTc和发射结的扩散电容Cde的影响，也要考虑基极电阻rb的作用，因为该电阻和电容组成的RC时间常数将会影响晶体管的高频性能。在高频时，由于rC1/CTc，故rc可以忽略。 Semiconductor Devices 2019/1/12

跨导gm：输入电导：输出电导： Semiconductor Devices 2019/1/12

较高频时输出端交流短路时高频小信号电路 Semiconductor Devices 2019/1/12

高频时，考虑基区宽度调制效应时存在有限的输出电导
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（3）频率－功率限制高频功率增益：定义高频优值U为功率增益与频率平方的乘积：标志晶体管的放大能力，也称增益一带宽积。最高振荡频率：式中，rb为基极电阻，CTC为集电极总输出电容。 Semiconductor Devices 2019/1/12

提高晶体管特征频率fT的途径在一般的高频晶体管中，减小B是提高fT的主要因素：降低晶体管的基区宽度WB，提高基区电场因子。减小发射结面积以减小CTe 。减小集电结的势垒宽度xjC，即降低集电区电阻率，但它又与提高击穿电压有矛盾。为此，必须根据不同要求作适当选择。减小集电极串联电阻rcs及集电结势垒电容CTc。为此一是降低集电区电阻率和减小集电区厚度，以减小rcs（但这也与提高击穿电压的要求矛盾）；二是缩小结面积以降低CTc。综合之，提高fT的主要途径是：减小基区宽度WB，减小结面积（发射结及集电结），适当降低集电区电阻率和厚度。 Semiconductor Devices 2019/1/12

§3.5 功率特性 1．最大集电极电流IC 为使晶体管电路的输出功率大，要求晶体管能输出较大的电流，但大电流工作的晶体管电流放大系数和截止频率都要下降，从而限制了输出功率。因此，在讨论晶体管的功率特性时，我们先讨论晶体管的最大集电极电流。基区电导调制效应及有效基区扩展效应(Kirk效应）均会使晶体管特性变差，因此必须定义各自的最大电流限制。最大集电极电流密度取决于上述两种效应中最小的最大发射极电流。 Semiconductor Devices 2019/1/12

2．功率晶体管的安全工作区(SOA) 晶体管的最大耗散功率晶体管的输出功率，除受到电学参数限制外，还受到热学参数的限制，这是由于电流的热效应使晶体管消耗一定的功率，引起管芯发热，此热量通过半导体、管壳等途径散到管外，称为晶体管的耗散功率。晶体管的最大耗散功率与热阻有如下关系：式中TjM为最高结温；TA为环境温度；RT是稳态热阻，与功率晶体管的结构、材料和各材料的厚度、面积和热导率等有关； Semiconductor Devices 2019/1/12

晶体管结温有一定限制，温度过高将会引起P-N结的热击穿。通常规定：锗晶体管的最高结温定为85125℃，硅晶体管则定为150200℃。 Semiconductor Devices 2019/1/12

晶体管的二次击穿实践表明，当晶体管工作在最大耗散功率范围内时，仍有可能发生击穿而被烧毁。一般认为，这是由于晶体管的二次击穿所引起的。当集电结反向偏压VCE逐渐增大到某一数值时，集电极电流IC急剧增加，这就是通常的雪崩击穿，称为一次击穿；继续增加集电结电压，使IC增大到某一临界值此VCE突然降低，而电流则继续增大，出现负阻效应，此称二次击穿。二次击穿的过程极短，通常为微秒量级，一旦发生二次击穿，如果没有保护措施，则晶体管很快就烧毁。 Semiconductor Devices 2019/1/12

安全工作区(SOA)是晶体管能安全工作的范围,它受四个参数限制: （1）集电极最大电流ICM。如果晶体管在脉冲状态工作，那么该电流可比直流时的ICM大1.53倍；（2）集电极最大耗散功率PCM。在直流工作时它取决于稳态热阻RT，在脉冲工作时，则取决于瞬态热阻RTS。通常ICVCE-1；（3）二次击穿临界功耗PSB曲线由实验决定，电流与电压有如下关系：IV-n；n在1.54之间；（4）最大电压VCEM。在线性放大区，VCEM=VSUS。 Semiconductor Devices 2019/1/12

§3.6 开关特性在叙述晶体管的三个工作区中已经注意到，如果晶体管工作在截止区，其输出阻抗很大，相当于电路“断开”；若晶体管工作在饱和区，则它的输出阻抗很小，相当于电路“接通”。这样使用的晶体管在电路中起着开关作用。晶体管由截止区转换到饱和区，或由饱和区转换到截止区，可以通过加在其输入端的外界信号来实现，因此，转换速度极快。近代电子计算机中所用的开关电路，就是根据晶体管的这一特性来设计的，其开关速度达每秒几十万次到几百万次，甚至更高。 Semiconductor Devices 2019/1/12

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（1）关断和导通阻抗为了表征开关作用，考虑三个基本参量。关断阻抗，导通阻抗和开关时间。关断阻抗：导通阻抗：由上面两式可知，结的反向饱和电流IEBO、ICBO小时，关断阻抗很高。导通阻抗近似反比于IC，当IC很大时，导通阻抗很小。通常，基区和集电区的欧姆电阻包含在总阻抗内，尤其对于导通阻抗。 Semiconductor Devices 2019/1/12

（2）开关时间开关时间的定义：晶体管从关态转变为开态的时间称为开启时间ton，由开态转变为关态的时间称为关断时间toff。由于在开关过程中集电极电流是交替变化的，电流开始上升或开始下降的时刻很难准确确定，工程上一般以最大值ICS的0.1或0.9倍进行测量，定义开关时间。延迟时间：从基极回路输入正脉冲信号起（t=0）到晶体管集电极电流升至0.1Ics为止，称为延迟时间td。上升时间：集电极电流由0.1Ics升至0.9Ics为止，称为上升时间tr。存贮时间：基极信号变负开始到集电极电流下降到0.9ICS，称为存贮时间ts。下降时间：集电极电流从0.9ICS下降到0.1ICS所需的时间为下降时间tf。 ton＝td+tr；toff＝ts＋tf；t＝ton+toff Semiconductor Devices 2019/1/12

利用电荷控制模型分析开关时间基区内存贮的总过剩少子电荷为（PNP管）：由连续性方程给出存贮电荷随时间的变化由此，可得电荷控制的基本方程：瞬态基极电流的作用 Semiconductor Devices 2019/1/12

延迟时间：存贮时间：式中，若t3>τp，则 Semiconductor Devices 2019/1/12

分析导通时间取决于如何迅速把空穴（PNP管的基区少子）或电子（NPN管的基区少子）注入到基区。关断时间取决于如何通过复合使空穴迅速消失。开关晶体管的重要参数之一是少子寿命。对高速开关管，降低少子寿命的有效方法是在禁带中心附近引入有效产生复合中心，如掺金工艺。 Semiconductor Devices 2019/1/12

（3）开关过程截止状态延迟过程上升过程超量存贮即饱和状态超量储存电荷消失过程即存贮时间下降过程 Semiconductor Devices 2019/1/12

提高开关速度的措施提高晶体管的开关速度，必须从改善器件性能及电路工作条件着手，这里我们仅讨论提高开关速度对器件性能的要求。 (1)提高晶体管的频率特性，要求： (a)减小结面积，使 CTe及CTc减小; (b)减小基区宽度WB，一般说fT主要决定于WB，减小WB可大大提高fT。 (2)在工艺上增加掺金工序，其原因是： (a)降低集电区少子寿命，可减少集电区中超量储存少子的数量，在储存时间内又可加速超量储存少子的消失，从而使ts减小；对NPN效果更好。 (b)析出凝聚在位错、层错处的重金属铜、铁等，以改善反向特性。 (c)掺金后的缺点：一是使反向漏电流增加，还减小了电流放大增益；二是使集电区电阻率增加，这是因为金起一定的施主或受主作用。 (3)减小集电区外延尽厚度WC，以减小超量储存的电荷。 Semiconductor Devices 2019/1/12

§3.7 晶体管的设计晶体管的主要设计指标：在通讯广播等设备上应用的N-P-N高频功率晶体管，甲类工作状态。其基本参数指标为： fT=1000MHz, 输出功率P0=5W, 功率增益Gp=5db, Vcc=28V, =40% Semiconductor Devices 2019/1/12

设计指标分析—细化到具体设计参数上 1、集电极维持电压：甲类状态VSUS2VCC=56V 2、最大集电极电流： ICM 4P0/VCC=0.72A 3、最大耗散功率：取晶体管的最大耗散功率PCM等于电源供给功率PD， Semiconductor Devices 2019/1/12

4、热阻：选取最高结温TjM=175C，环境温度Ta=25 C,热阻 5、高频优值和特征频率：在工作频率1000MHz下，高频优值需 Gp·f23.21018(Hz)2 取fT=1500MHz, Semiconductor Devices 2019/1/12

总体设计方案考虑 1、工艺：外延平面双扩散工艺 2、图形结构形式：对高频功率晶体管的设计应兼顾功率特性与频率特性两方面的要求。选用覆盖式结构，该结构的图形优值较大，且本设计中的频率要求较高 Semiconductor Devices 2019/1/12

3、集电结的形状：在集电结面积一定的条件下，正方形具有最小的周界长度在集电结周界上发生低击穿的几率就小一些，有利于提高产品合格率。故低频大功率晶体管和高频小功率晶体管均为正方形。超高频功率晶体管所以高频功率晶体管集电结的形状设计就必须考虑周界长度问题，选取较长的矩形，这可能会牺牲一些合格率。 4、封装形式：管壳封装面积缩小许多耗散功率大了许多 Semiconductor Devices 2019/1/12

纵向结构参数的设计 1、外延层电阻率的选取:集电区外延层杂质浓度NC主要由集电结击穿电压V(BR)CBO决定对硅平面型N-P-N晶体管，取n=4,令hFE=10-15，则V(BR)CBO=102~112V 根据杂质浓度与击穿电压关系曲线查得NC51015cm-3,考虑到较高的外延杂质浓度可以降低集电极串联电阻，提高频率特性，故选取NC=41015cm-3 Semiconductor Devices 2019/1/12

纵向结构参数的设计 2、基区宽度: 若采用扩散工艺 =21017cm DnB=11cm2/s WB=(0.560.62m) 取 WB=0.5m也是可行的 Semiconductor Devices 2019/1/12

纵向结构参数的设计 3、发射结和集电结结深：由于采用磷硼扩散工艺，需考虑emitter- push effect ，若取xje/xjc=0.6,WB=1/3WB,而 xjc=xje+WB- WB  xje=WB=0.5m,xjc=0.83m(考虑push effect, xjc’= /3=1m) Semiconductor Devices 2019/1/12

4、外延层厚度的选取考虑击穿条件下的集电结耗尽区宽度以及反扩散，Wepi=13~14 m
纵向结构参数的设计 4、外延层厚度的选取考虑击穿条件下的集电结耗尽区宽度以及反扩散，Wepi=13~14 m Semiconductor Devices 2019/1/12

纵向结构参数的设计 5、纵向结构设计参数汇总：基区宽度WB WB=0.5m 淡基区硼扩散结深xjc Xjc=0.83m 浓基区硼扩散结深xjc’’ xjc’’=2.5m 外延层厚度Wepi Wepi=1314m 淡基区表面杂质浓度NBO NBO=31019cm-3 淡基区硼扩薄层电阻 150/方块浓基区表面杂质浓度 NBO’=3.51020cm-3 浓基区硼扩薄层电阻 5/方块发射区表面杂质浓度 NEO=11021cm-3 发射区磷扩薄层电阻 20/方块内基区薄层电阻 3100/方块外延层杂质浓度 NC=41015cm-3 外延层电阻率 C=1.2cm Semiconductor Devices 2019/1/12

横向结构参数的设计 1、单元发射区的宽度、长度和个数的确定： =2.5×1017cm-3，DnB=11cm2/s， WB=0.5m ：（基区电导调制）（基区扩展）  JCM=Jcr (最大电流密度） Semiconductor Devices 2019/1/12

横向结构参数的设计 — 发射极总周长可以把发射极条宽度选为2m，但工艺限制，确定为8m。 —生产实际中常取le=(4~8)Se=(32~64) m, 这里取le=60 m Semiconductor Devices 2019/1/12

取90个，为使散热性能良好，把有源区面积确定为狭长的矩形。故把发射极单元在其长度方向上排列10列，在其宽度方向上排列9行。
横向结构参数的设计取90个，为使散热性能良好，把有源区面积确定为狭长的矩形。故把发射极单元在其长度方向上排列10列，在其宽度方向上排列9行。 Semiconductor Devices 2019/1/12

横向结构参数的设计 2、发射极引线孔尺寸的确定：发射区条宽8m,最小套刻间距2 m：引线孔宽度为4 m 3、浓、淡基区窗口尺寸的确定：由于发射区扩散较浅，故可以忽略其横向扩散，浓基区扩散深度2.5m,假定其横向扩散为纵向深度的一半，即1.25 m,作为近似估算，操作对位误差为0.75 m,光刻版的误差及侧向腐蚀误差为1 m：总的间距大于3 m。所以取Seb=4 m Semiconductor Devices 2019/1/12

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4、铝金属电极尺寸的确定 5、光刻版图形尺寸：
横向结构参数的设计 4、铝金属电极尺寸的确定 5、光刻版图形尺寸：最小光刻间距2m Se=8m le=60m n=90 单元E引线孔宽度4m 单元E引线孔长度46m 单元淡基区宽度16m 单元淡基区长度68m 浓基区网格宽度Sb1=5m 基极引线孔的宽度Sb2=10m 淡基区轮廓792196m2 浓基区轮廓794198m2 LE=1.2cm 结面积 AE= 4.3210-4cm2 基区结面积AB=AC= 1.5710-3 cm2 Semiconductor Devices 2019/1/12

主要参数验算（略） Semiconductor Devices 2019/1/12

§3.8 异质结晶体管HBT heterogenous bipolar transistor
最重要的异质结材料是Ⅲ-V族化合物半导体，如GaAs及其三元化合物AlxGa1-xAs之类的固溶体，其中x可以从0变化到1。当x=0时为砷化镓，在300K下禁带宽度为1.42eV,晶格常数为5.6533Å；当x=1时为砷化铝（AlAs），它的禁带宽度为2.17eV，晶格常数为 Å。三元化合物AlxGa1-xAs的禁带宽度随x增加而增加，而晶格常数基本上保持不变。甚至在x=0和x=1时的极端情况下，晶格常数的失配也仅有0.1%。异质结双极晶体管器件用n-AlxGa1-xAs作发射区，p-GaAs作基区,n-GaAs作集电区。 Semiconductor Devices 2019/1/12

假定发射结是缓变异质结，该晶体管工作原理类似于通常的晶体管。在放大状态下，基极电流主要包括发射结耗尽层内的复合电流IER，基区内复合而必须补偿空穴损失的电流IBR，基区向发射区注入的空穴电流IEp。集电极电流主要来自发射区注入并穿过基区的电流ICn，共发射极电流增益表达式为：这里，βmax表示注入比，也是晶体管受注入比限制时的最大电流增益。 Semiconductor Devices 2019/1/12

根据晶体管理论有其中，由此可得，其中，DnB是电子在基区的扩散系数，DpE、LpE是空穴在发射区的扩散系数和扩散长度，WB为基区宽度。 Semiconductor Devices 2019/1/12

异质结双极型晶体管有许多优点：（1）发射效率高。这是因为空穴（对于N-P-N晶体管的发射区来说，空穴是少数载流子）从基区向发射区注入时，受到价带高势垒的阻碍；（2）基区电阻小。这是因为基区可以重掺杂而不损失发射效率；（3）可减小发射极电流集边效应。这是因为发射区一基区结上的电压降很小；（4）改善了频率响应。这是因为电流增益大，基区电阻小。此外，异质结双极晶体管可以采用某些高温性能好的材料。可使器件工作温度达300℃以上。利用外延技术可以制成各种各样的异质结双极晶体管。其中包括采用组分缓变的材料作基区的器件，例如用AlxGa1-xAs作基区，x值从发射结递减到集电结，以提供一个内建电场，减小基区渡越时间。也有采用双异质结结构的器件（宽禁带发射区和宽禁带集电区），以使发射结和集电结对称，从而改善放大状态和反转状态下的电流增益，常见的有AlGaAs/GaAs HBT,InGaAs/InP HBT，Si/Si1-xGex HBT等。 Semiconductor Devices 2019/1/12

双极晶体管优点电子沿垂直方向流过器件。器件尺寸可精确控制，容易制造出电子渡越时间短、截止频率高的器件；导通电流流经整个发射区，单位芯片面积上的电流密度可以很大，实现大电流输出；集电极电流的载流子密度直接由输入电压控制，跨导可以很高；开启电压由pn结内建电场决定，而不依赖于器件尺寸和工艺的变化；输入电容一般用工作电流衡量，大小主要由扩散电容决定，因此适应驱动负载能力强；在高压大电流电路中，由于电子和空穴的双注入，有可能获得轻掺杂集电区电阻的电导调制，使串联电阻小。 Semiconductor Devices 2019/1/12

双极晶体管缺点在DC工作下需要一定的输入基极电流；工作在饱和区时，基极电流增加，过剩电荷存贮，使开关速度变缓，难以用于逻辑电路；在电路中，阈值电压不能作为设计参数。目前只能制造具有正阈值电压的晶体管；目前通过先进的工艺技术能使器件的尺寸和寄生效应变的更小，异质结的使用在晶体管的设计中增加一个新的自由度，使器件更快。在BiCMOS技术中双极与FET相结合可获得超高输入阻抗并可实现在逻辑电路中的信号开关旁路晶体管。 Semiconductor Devices 2019/1/12

Principle of Semiconductor Devices
总结与展望双极晶体管具有高的fT和gm，主要应用在高速电路和大功率器件。速度过冲效应新材料 NPN和PNP构成类CMOS电路与其它器件的集成：BiCMOS Principle of Semiconductor Devices 2019/1/12

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