桶式移位器 简单浮点编码器 双优先级编码器 级联比较器 关模比较器 第6章 组合电路设计实例 桶式移位器 简单浮点编码器 双优先级编码器 级联比较器 关模比较器 制作：金燕华

桶式移位器 具有n个数据输入和n个数据输出 控制输入：指定输入输出之间如何移动数据 （移位方向、移位类型、移动的位数） 设计一个简单16位桶式移位器（向左移位） 用4位控制输入S[3:0]指定移动位数，例: S=0101， 若输入：0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 则输出：5 6 7 8 9 10 11 12 13 14 15 0 1 2 3 4 思路：输出的每一位都是从16个输入中选出的。 ——多路复用器（数据选择器） 制作：金燕华

方案一：利用74x151 1、如何扩展路复用器？ 74x151 16个输入端；4个地址选择端； D[15:0] EN CBA Y D7~D0 B Y C Y D0 D7 74x151 1、如何扩展路复用器？ 16个输入端；4个地址选择端； D[15:0] EN CBA Y D7~D0 S3 S[2:0] Y S[3:0] Y D[7:0] D[15:8] 当S=0101时 Y=D5 制作：金燕华

方案一：利用74x151 2、当S=0101时，如何使输出为 DIN6, …, DIN15, …, DIN4？ 74x151 EN A B Y C Y D0 D7 74x151 2、当S=0101时，如何使输出为 DIN6, …, DIN15, …, DIN4？ EN CBA Y D7~D0 D[7:0] D[15:8] S3 Y S[2:0] DIN[0,15:9] DIN[7:0] DIN[15:8] 通过控制数据输入端的连接 当S=0101时 Y=D5 DIN[8:1] 制作：金燕华

P334 图6-1 DOUT[15:0] DIN[14:7] DIN[6:0,15] 74x151 DOUT15 DIN[13:6] S3 S[2:0] DIN[0,15:9] DIN[8:1] DIN[15:8] DIN[7:0] S[3:0] 制作：金燕华

P334 图6-1 负载太大 DOUT[15:0] 利用三态输出 74x251 基本原理： DIN[14:7] DIN[6:0,15] DIN[13:6] DIN[5:0,15,14] DIN[0,15:9] DIN[8:1] DIN[15:8] DIN[7:0] DIN[15:0] S[3:0] S[2:0] S3 74x251 DOUT[15:0] 利用三态输出 74x251 基本原理： 利用多路复用器，通过控制数据输入端的连接使输出产生移位。 负载太大 制作：金燕华

方案二：利用74x157 如何利用2输入4位多路复用控制移位？ 74x157 基本原理： G S A4~A0 B4~B0 Y4~Y0 74x157 基本原理： 利用多路复用器，通过控制数据输入端的连接使输出产生移位。 DIN[3:0] DIN[2:0,3] 当S=0时，Y=A，不移位 当S=1时，Y=B，相当于右移一位 改变A端输入数据的连接顺序 可以使输出：左/右移动一或多位 制作：金燕华

通 过 S0 控 制 16 位 多 路 复 用 器 移 74x157 DI[15:0] YO[3:0] YO[7:4] YO[11:8] A4~A0 B4~B0 G S Y4~Y0 通 过 S0 控 制 16 位 多 路 复 用 器 移 DI[3:0] DI[7:4] DI[11:8] DI[15:12] DI[15:0] YO[3:0] YO[7:4] YO[11:8] YO[15:12] YO[15:0] DI[2:0,15] DI[6:3] DI[10:7] DI[14:11] S0 A4~A0 B4~B0 G S Y4~Y0 制作：金燕华

74x157 S0 74x157 S1 74x157 S2 74x157 S3 S[3:0] Si=1： 移动1位 移动2位 移动4位 DI[15:0] DO[15:0] 74x157 S0 74x157 S1 74x157 S2 74x157 S3 S[3:0] Si=1： 移动1位 移动2位 移动4位 移动8位 Si=0： 不移动 节省器件，延迟大，P335 图6-2 制作：金燕华

浮点编码器 11010110100 ＝ 1101×27 ＋ 0110100 00100101111 ＝ 1001×25 ＋ 01111 00000000010 ＝ 0010×20 ＋ 0 2111 2101 2000 截位误差 浮点数的表示： B ＝ M × 2E ＋ T 3位指数 从第一个“1”开始取4位 首先解决的几个问题： ⑴ 如何确定第一个“1”的位置？ ⑵ 如何确定3位指数？ ⑶ 如何从第一个“1”开始选出4位？ 由第一个“1”的位置决定 —— 优先编码器 —— 优先编码器的输出 —— 数据选择器 制作：金燕华

（3）如何从第一个“1”开始选出4位M3M2M1M0？ （1）如何确定第一个“1”的位置？ —— 优先编码器 （2）如何确定3位指数？ （3）如何从第一个“1”开始选出4位M3M2M1M0？ 11010110100 00100101111 00000000010 B ＝ M×2E＋T A2 A1 A0 GS EO EI I7 I1 I0 74x148 E2_L E1_L E0_L B10_L B4_L B3_L 通常 M3=1 只有B10_L～B3_L都无效 M3=0 （由GS端获得） 制作：金燕华

（3）如何从第一个“1”开始选出4位M3M2M1M0？ （1）如何确定第一个“1”的位置？ P337 图6-3 （2）如何确定3位指数？ （3）如何从第一个“1”开始选出4位M3M2M1M0？ —— 多路复用器 只需要选出 M2 M1 M0 EN Y A B C D0 D1 D7 74x151 同样的，通过改变 数据输入端的连接 可以得到M2M1M0 E0_L E1_L E2_L M2_L B9_L B8_L B2_L 通常 M3=1 只有B10_L～B3_L都无效 M3=0（由GS端获得） 制作：金燕华

双优先级编码器 可以找出最高和第二高优先级的编码器 如何找第二高优先级？ 74x148 先“排除”最高优先输入 再用74x148找一次 EI A2~A0 GS EO EI 74x148 I7~I0 利用74x148 找出最高优先级 其他输入不变 强制最高优先输入无效 —— 利用译码器和“与门”实现 （注意有效电平） 需要2个优先编码器 1个译码器、若干“与门” 制作：金燕华

74x138 74x148 GI EI A2~A0 G2A,B GS EO Y7~Y0 I7~I0 CBA A[2:0] AVALID EI 最高优先输入为0，其余输入为1 R_L[7:0] A2~A0 GS EO EI 74x148 I7 I0 B[2:0] BVALID 制作：金燕华

关模比较器 输入：两个8位无符号二进制整数 X 和 Y 一个控制信号 M 输出：8位无符号二进制整数 Z 逻辑功能：M = 1，Z = min(X,Y) M = 0，Z = max(X,Y) G S 1A~4A 1B~4B 74x157 1Y~4Y 思路：（核心问题） （1）比较X,Y的大小 （2）使Z为X,Y之一 （3）控制逻辑 —— 比较器（8位） ——多路复用器（二选一） ——根据M和X,Y大小控制 多路复用器的地址选择端。 制作：金燕华

关模比较器原理框图 思路：（核心问题） （1）比较X,Y的大小 —— 比较器（8位） （2）使Z为X,Y之一 （3）控制逻辑 M 比较器 X Y X>Y 多路 复用 器 Z 关模比较器原理框图 思路：（核心问题） （1）比较X,Y的大小 （2）使Z为X,Y之一 （3）控制逻辑 —— 比较器（8位） ——多路复用器（二选一） ——根据M和X,Y大小控制 多路复用器的地址选择端。 制作：金燕华

M S=0  Y=A S=1  Y=B 控制逻辑 X 比较器 Y 74x157 多路 G 复用器 Z S 1Y~4Y 1A~4A 1B~4B 74x157 1Y~4Y Z[7:0] P7~0 Q7~0 74x682 P=Q P>Q M X[7:0] Y[7:0] 制作：金燕华

P341图6-8 S=0  Y=A S=1  Y=B M P>Q_L S 0 0 0 1 1 0 1 1 M=1，min(X,Y) 0 0 0 1 1 0 1 1 M=1，min(X,Y) M=0，max(X,Y) 1 G S 1A~4A 1B~4B 74x157 1Y~4Y P7~0 Q7~0 74x682 P=Q P>Q X[7:0] Y[7:0] Z[7:0] P341图6-8 M 制作：金燕华

桶式移位器 简单浮点编码器 双优先级编码器 级联比较器 关模比较器 第6章 组合电路设计实例 桶式移位器 简单浮点编码器 双优先级编码器 级联比较器 关模比较器 制作：金燕华

桶式移位器 思路：输出的每一位都是从16个输入中选出的 具有n个数据输入和n个数据输出 ——多路复用器（数据选择器） 需要解决的问题： （1）需要多少个16选1的多路复用器？ （2）如何控制输出移位？ 具有n个数据输入和n个数据输出 控制输入：指定输入输出之间如何移动数据 （移位方向、移位类型、移动的位数） 设计一个简单16位桶式移位器（向左移位） 16个数据输入和16个数据输出 用4位控制输入S[3:0]指定移动位数，例: S=0101， 若输入：0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 则输出：5 6 7 8 9 10 11 12 13 14 15 0 1 2 3 4 制作：金燕华

方案一：利用74x151 1、如何扩展路复用器？ 74x151 16个输入端；4个地址选择端； D[15:0] EN CBA Y D7~D0 B Y C Y D0 D7 74x151 1、如何扩展路复用器？ 16个输入端；4个地址选择端； D[15:0] EN CBA Y D7~D0 S3 S[2:0] Y S[3:0] Y D[7:0] D[15:8] 当S=0101时 Y=D5 制作：金燕华

2、如何产生移位？？ 通过控制数据输入端的连接产生移位 DI0 DI1 DI2 DI3 DI4 DI5 DI6 DI7 EN CBA D0 74x151 Y S[2:0] Y0 EN CBA D0 D1 D2 D3 D4 D5 D6 D7 74x151 Y DI2 DI3 DI4 DI5 DI6 DI7 DI0 DI1 S[2:0] Y2 DI1 DI2 DI3 DI4 DI5 DI6 DI7 DI0 S[2:0] Y1 制作：金燕华

2、如何产生移位？？ 通过控制数据输入端的连接产生移位 74x151 绿色表示高位 红色表示低位 EN CBA Y D7~D0 B Y C Y D0 D7 74x151 通过控制数据输入端的连接产生移位 74x151 绿色表示高位 红色表示低位 EN CBA Y D7~D0 DIN[7:0] DIN[15:8] Y0 S[2:0] S3 DIN[8:1] DIN[0,15:9] Y1 制作：金燕华

P334 图6-1 DOUT[15:0] DIN[14:7] DIN[6:0,15] 74x151 DOUT15 DIN[13:6] S3 S[2:0] DIN[0,15:9] DIN[8:1] DIN[15:8] DIN[7:0] S[3:0] 制作：金燕华

P334 图6-1 并行处理 负载太大 DOUT[15:0] 利用三态输出 74x251 基本原理： DIN[14:7] DIN[6:0,15] DIN[13:6] DIN[5:0,15,14] DIN[0,15:9] DIN[8:1] DIN[15:8] DIN[7:0] DIN[15:0] S[3:0] S[2:0] S3 74x251 DOUT[15:0] 利用三态输出 74x251 基本原理： 利用多路复用器，通过控制数据输入端的连接使输出产生移位。 并行处理 负载太大 制作：金燕华

方案二：利用74x157 如何利用2输入4位多路复用控制移位？ 74x157 基本原理： G S A4~A0 B4~B0 Y4~Y0 74x157 基本原理： 利用多路复用器，通过控制数据输入端的连接使输出产生移位。 DIN[3:0] DIN[2:0,3] 当S=0时，Y=A，不移位 当S=1时，Y=B，相当于移动一位 改变A端输入数据的连接顺序 可以使输出：左/右移动一或多位 制作：金燕华

74x157 DI[15:0] YO[3:0] YO[7:4] YO[11:8] YO[15:12] YO[15:0] S = 0 A4~A0 B4~B0 G S Y4~Y0 DI[3:0] DI[7:4] DI[11:8] DI[15:12] DI[15:0] YO[3:0] YO[7:4] YO[11:8] YO[15:12] YO[15:0] DI[2:0,15] DI[6:3] DI[10:7] DI[14:11] S = 0 Y = A 不移位 S = 1 Y = B 移动1位 S0 A4~A0 B4~B0 G S Y4~Y0 注意移位方向 制作：金燕华

74x157 S0 74x157 S1 74x157 S2 74x157 S3 S[3:0] Si=1： 移动1位 移动2位 移动4位 DI[15:0] DO[15:0] 74x157 S0 74x157 S1 74x157 S2 74x157 S3 S[3:0] Si=1： 移动1位 移动2位 移动4位 移动8位 Si=0： 不移动 串行方式，节省器件，延迟大，P335 图6-2 制作：金燕华

浮点编码器 11010110100 ＝ 1101× 27 ＋ 0110100 00100101111 ＝ 1001× 25 ＋ 01111 00000000010 ＝ 0010× 20 ＋ 0 2111 2101 2000 截位误差 浮点数的表示： B ＝ M × 2E ＋ T 3位指数 从第一个“1”开始取4位 首先解决的几个问题： ⑴ 如何确定第一个“1”的位置？ ⑵ 如何确定3位指数？ ⑶ 如何从第一个“1”开始选出4位？ 由第一个“1”的位置决定 —— 优先编码器 —— 优先编码器的输出 —— 数据选择器 制作：金燕华

（3）如何从第一个“1”开始选出4位M3M2M1M0？ （1）如何确定第一个“1”的位置？ —— 优先编码器 （2）如何确定3位指数？ （3）如何从第一个“1”开始选出4位M3M2M1M0？ 11010110100 00100101111 00000000010 B ＝ M×2E＋T A2 A1 A0 GS EO EI I7 I1 I0 74x148 E2_L E1_L E0_L B10_L B4_L B3_L 通常 M3=1 只有B10_L～B3_L都无效 M3=0 （由GS端获得） 制作：金燕华

（3）如何从第一个“1”开始选出4位M3M2M1M0？ （1）如何确定第一个“1”的位置？ P337 图6-3 （2）如何确定3位指数？ （3）如何从第一个“1”开始选出4位M3M2M1M0？ —— 多路复用器 只需要选出 M2 M1 M0 EN Y A B C D0 D1 D7 74x151 同样的，通过改变 数据输入端的连接 可以得到M2M1M0 注意 有效 电平 M2_L E0_L E1_L E2_L B9_L B8_L B2_L E2 E1 E0 M2 B2 B3 B9 通常 M3=1 只有B10_L～B3_L都无效 M3=0（由GS端获得） 制作：金燕华

双优先级编码器 可以找出最高和第二高优先级的编码器 如何找第二高优先级？ 74x148 先“排除”最高优先输入 再用74x148找一次 EI A2~A0 GS EO EI 74x148 I7~I0 利用74x148 找出最高优先级 其他输入不变 强制最高优先输入无效 —— 利用译码器和“与门”实现 （注意有效电平） 需要2个优先编码器 1个译码器、若干“与门” 制作：金燕华

74x138 74x148 GI EI A2~A0 G2A,B GS EO Y7~Y0 I7~I0 CBA A[2:0] AVALID EI 最高优先输入为0，其余输入为1 R_L[7:0] A2~A0 GS EO EI 74x148 I7 I0 B[2:0] BVALID 制作：金燕华

级联比较器 3片74x682构成24位比较器 P0~P7 P=Q Q0~Q7 P>Q PEQQ P338 6.1.4 [7:0] [15:8] [23:16] P338 6.1.4 P340 图6-7 PGTQ 制作：金燕华

关模比较器 输入：两个8位无符号二进制整数 X 和 Y 一个控制信号 M 输出：8位无符号二进制整数 Z 逻辑功能：M = 1，Z = min(X,Y) M = 0，Z = max(X,Y) G S 1A~4A 1B~4B 74x157 1Y~4Y 思路：（核心问题） （1）比较X,Y的大小 （2）使Z为X,Y之一 （3）控制逻辑 —— 比较器（8位） ——多路复用器（二选一） ——根据M和X,Y大小控制 多路复用器的地址选择端。 制作：金燕华

关模比较器原理框图 思路：（核心问题） （1）比较X,Y的大小 —— 比较器（8位） （2）使Z为X,Y之一 （3）控制逻辑 M 比较器 X Y X>Y 多路 复用 器 Z 关模比较器原理框图 思路：（核心问题） （1）比较X,Y的大小 （2）使Z为X,Y之一 （3）控制逻辑 —— 比较器（8位） ——多路复用器（二选一） ——根据M和X,Y大小控制 多路复用器的地址选择端。 制作：金燕华

M S=0  Y=A S=1  Y=B 控制逻辑 X 比较器 Y 74x157 多路 G 复用器 Z S 1Y~4Y 1A~4A 1B~4B 74x157 1Y~4Y Z[7:0] P7~0 Q7~0 74x682 P=Q P>Q M X[7:0] Y[7:0] 制作：金燕华

P341图6-8 S=0  Y=A S=1  Y=B M P>Q_L S 0 0 0 1 1 0 1 1 M=1，min(X,Y) 0 0 0 1 1 0 1 1 M=1，min(X,Y) M=0，max(X,Y) 1 G S 1A~4A 1B~4B 74x157 1Y~4Y P7~0 Q7~0 74x682 P=Q P>Q X[7:0] Y[7:0] Z[7:0] P341图6-8 M 制作：金燕华

第4章 组合逻辑设计原理 第5章 组合逻辑设计实践 第6章 组合电路设计实例 组合逻辑部分小结 第4章 组合逻辑设计原理 第5章 组合逻辑设计实践 第6章 组合电路设计实例 制作：金燕华

第4章 基本原理 开关代数基础 组合逻辑的基本分析、综合方法 冒险 开关代数的公理、定理 对偶、反演规则 逻辑函数的表示法 第4章 基本原理 开关代数的公理、定理 对偶、反演规则 逻辑函数的表示法 开关代数基础 组合逻辑的基本分析、综合方法 冒险 分析步骤，利用公式进行化简 设计方法、步骤 利用卡诺图化简，电路处理 无关项的化简、多输出函数的化简 —— 冒险的检查和消除 制作：金燕华

组合电路的分析 分析的目的： 分析步骤： 确定给定电路的逻辑功能 由输入到输出逐级写出逻辑函数表达式 对输出逻辑函数表达式进行化简 判断逻辑功能（列真值表或画波形图） 制作：金燕华

分析图示逻辑电路的功能 B3 B2 B1 B0 G3 G2 G1 G0 B3 B2 B1 B0 G3 G2 G1 G0 G3 = B3 0 0 0 0 0 0 0 1 0 0 1 0 0 0 1 1 0 1 0 0 0 1 0 1 0 1 1 0 0 1 1 1 1 0 0 0 1 0 0 1 1 0 1 0 1 0 1 1 1 1 0 0 1 1 0 1 1 1 1 0 1 1 1 1 B3 B2 B1 B0 G3 G2 G1 G0 B3 B2 B1 B0 G3 G2 G1 G0 0 0 0 0 0 0 0 1 0 0 1 1 0 0 1 0 0 1 1 0 0 1 1 1 0 1 0 1 0 1 0 0 1 1 0 0 1 1 0 1 1 1 1 1 1 1 1 0 1 0 1 0 1 0 1 1 1 0 0 1 1 0 0 0 G3 = B3 G2 = B3B2 G1 = B2B1 G0 = B1B0 解：1、写表达式 2、列真值表 3、分析功能 二进制码至格雷码的转换电路 制作：金燕华

组合电路的综合 用门电路 问题 描述 逻辑 抽象 选定 器件 类型 函数化简 电路处理 将函数 式变换 电路 实现 真值表 或 函数式 用MSI组合电路或PLD 制作：金燕华

设计2位数乘法器 P2 1、列真值表 输入：X、Y（2位） 输出：乘积P（4位） 2、用门电路实现 利用卡诺图化简 注意：多输出函数 Y1Y0 X1X0 00 01 11 10 00 01 11 10 P2 设计2位数乘法器 0 0 0 1 1 0 1 1 X1 X0 Y1 Y0 0 0 0 0 0 0 0 1 0 0 1 0 0 0 1 1 0 1 0 0 0 1 1 0 1 0 0 1 P3 P2 P1 P0 1、列真值表 输入：X、Y（2位） 输出：乘积P（4位） 1 2、用门电路实现 利用卡诺图化简 注意：多输出函数 3、电路处理 P3 = X1·X0·Y1·Y0 制作：金燕华

P2 P3 = X1·X0·Y1·Y0 P2 = X1·Y1 · (X1·X0·Y1·Y0)’ = X1·Y1·P3’ X1X0 00 01 11 10 00 01 11 10 P2 1 P3 = X1·X0·Y1·Y0 P2 = X1·Y1 · (X1·X0·Y1·Y0)’ = X1·Y1·P3’ Y1Y0 X1X0 00 01 11 10 00 01 11 10 1 制作：金燕华

P2 P3 = X1·X0·Y1·Y0 P2 = X1·Y1·P3’ P1 = X1·Y0·P3’+X0·Y1·P3’ P0 = X0·Y0 00 01 11 10 00 01 11 10 P2 1 P3 = X1·X0·Y1·Y0 P2 = X1·Y1·P3’ P1 = X1·Y0·P3’+X0·Y1·P3’ P0 = X0·Y0 1 Y1Y0 X1X0 00 01 11 10 00 01 11 10 P0 1 Y1Y0 X1X0 00 01 11 10 00 01 11 10 P1 1 制作：金燕华

考虑：用用译码器实现 —— 直接表示为标准和形式 P3 = X1·X0·Y1·Y0 比较： P2 = X1·Y1·P3’ P1 = X1·Y0·P3’+X0·Y1·P3’ P0 = X0·Y0 比较： 按多输出化简（蓝色） 按单个卡诺图化简（黑色） P3 = X1 · X0 · Y1 · Y0 P2 = X1·X0·Y1 + X1·Y1·Y0’ P1 = X1·Y1’·Y0 + X1·X0’·Y0 + X0·Y1·Y0’ + X1’·X0·Y1 P0 = X0 · Y0 考虑：用用译码器实现 —— 直接表示为标准和形式 制作：金燕华

人的血型有A、B、AB、O四种，输血者的血型与受血者的 血型必须符合下面的关系。 设计逻辑电路判断输血者与受血者的血型是否符合规定。 解：1、逻辑抽象，得真值表 用X1X0对应输血者的血型（00~11） 用Y1Y0对应受血者的血型（00~11） 输出F，1表示可以输血，0表示不行 A B AB O 输血者 受血者 00 01 10 11 0 0 0 0 0 0 0 1 0 0 1 0 0 0 1 1 0 1 0 0 X1X0 Y1Y0 F 1 2、用门电路实现 卡诺图化简 （略） 利用译码器 利用多路复用器 制作：金燕华

第5,6章 设计实践 常用的中规模集成电路（MSI） 文档标准和电路定时（了解） 编码器、译码器、多路复用器、奇偶校验、 第5,6章 设计实践 常用的中规模集成电路（MSI） 编码器、译码器、多路复用器、奇偶校验、 比较器、加法器、三态器件 掌握基本功能，级联的方法 综合应用：利用基本MSI器件作为基本单元设计更复杂的组合逻辑电路 文档标准和电路定时（了解） 制作：金燕华

设计减法器 方法一：利用真值表化简 方法二：利用加法器设计减法器 二进制减法表（P22表2-3） D = X  Y  BI BO = X’·Y + X’·BI + Y·BI 方法二：利用加法器设计减法器 （X－Y）相当于（X＋Y补） 对Y求补：逐位求反＋1 X0 Y0 X1 Y1 Xn Yn X Y CI CO S 1 B_L D0 D1 Dn 制作：金燕华

设计将BCD码转换成余3码的码制转换电路 思考：有没有更好的方法？？？ 方案一：利用基本门电路（SSI）实现 1、列真值表 0 0 0 0 0 0 0 1 0 0 1 0 0 0 1 1 0 1 0 0 0 1 0 1 0 1 1 0 0 1 1 1 1 0 0 0 1 0 0 1 1 0 1 0 … … 1 1 1 1 X3~X0 F3~F0 1、列真值表 0 0 1 1 0 1 0 0 0 1 0 1 0 1 1 0 0 1 1 1 1 0 0 0 1 0 0 1 1 0 1 0 1 0 1 1 1 1 0 0 2、卡诺图化简（多输出函数） 3、电路处理，得到电路图 “与-或”式  “与非-与非”式 “或-与”式  “或非-或非”式 方案二：利用中规模集成电路MSI实现 —— 译码器实现多输出函数 d 思考：有没有更好的方法？？？ 制作：金燕华

X1X0 X3X2 00 01 11 10 00 01 11 10 F3 1 d X1X0 X3X2 00 01 11 10 00 01 11 10 F2 1 d X1X0 X3X2 00 01 11 10 00 01 11 10 F0 1 d X1X0 X3X2 00 01 11 10 00 01 11 10 F1 1 d 制作：金燕华

设计将BCD码转换成余3码的码制转换电路 一个更好的方法：余3码 ＝ BCD码 ＋ 3 —— 利用加法器（MSI）实现 74x283 VCC A0 A1 A2 A3 B0 B1 B2 B3 C0 S0 S1 S2 S3 C4 74x283 X0 X1 X2 X3 F0 F1 F2 F3 VCC 1 制作：金燕华

实现两个BCD码的加法运算 思考：两个BCD码与两个4位二进制数相加的区别 如果(X+Y)产生进位信号C 或 在 1010~1111 之间 需要进行修正 —— 结果加6 利用 F 表示是否需要修正 F = C + S3·S2·S1·S0 + S3·S2·S1·S0’ + S3·S2·S1’·S0 + S3·S2·S1’·S0’ + S3·S2’·S1·S0 + S3·S2’·S1·S0’ X1X0 X3X2 00 01 11 10 00 01 11 10 1 F = C + S3·S2 +S3·S1 制作：金燕华

实现两个BCD码的加法运算 需要2个加法器，分别进行加法运算和修正 判别逻辑： F = C + S3·S2 +S3·S1 电路组成 相加 A0 S0 A1 S1 A2 S2 A3 S3 B0 B1 B2 B3 C0 C4 74x283 判别 修正 A0 S0 A1 S1 A2 S2 A3 S3 B0 B1 B2 B3 C0 C4 74x283 X0 X1 X2 X3 Y0 Y1 Y2 Y3 F0 F1 F2 F3 F C 制作：金燕华

 分析下面电路，写出输出与输入之间的关系 已知：输出为二进制数， X3~0 和 Y3~0 为十进制数的BCD码 将十进制BCD数YX转换为二进制数Z (0100 1000)BCD = (0110000)2 Y1 Y0 Y1 Y0 0 X3 X2 X1 X0 + C S3 S2 Z2 Z1 Z0 CI A3 A2 A1 A0 CO B3 S3 B2 S2 B1 S1 B0 S0  Y1 Y0 X3 X2 X1 X0 Y3 Y2 Z6 Z5 Z4 Z3 Z2 Z1 Z0 + Y3 Y2 Y3 Y2 0 0 0 Z6 Z5 Z4 Z3 Z2 Z1 Z0 Y3 Y2 Y1 Y0 0 X3 X2 X1 X0 + Y3 Y2 Y1 Y0 0 0 0 Z6 Z5 Z4 Z3 Z2 Z1 Z0 Z = X+Y*2+Y*8 = X+Y*10 制作：金燕华

第4章教学大纲要求 重点学习掌握逻辑代数的公理、定理，对偶关系，以及在逻辑代数化简时的作用；逻辑函数的表达形式：积之和与和之积标准型、真值表；组合电路的分析：逻辑函数表达式的产生过程及逻辑函数表达式的基本化简方法——函数化简方法；组合电路的综合过程：将功能叙述表达为组合逻辑函数的表达形式、逻辑函数表达式的化简——函数化简方法和卡诺图化简方法、使用与非门、或非门表达的逻辑函数表达式、逻辑函数的最简表达形式及综合设计的其他问题：无关项的处理、冒险问题和多输出逻辑化简的方法。（共10学时） 制作：金燕华

第5,6章教学大纲要求 重点学习掌握：学习利用基本的逻辑门完成规定的组合逻辑电路的设计任务：如译码器、编码器、多路选择器、多路分配器、异或门、比较器、全加器。学习利用基本的逻辑门和已有的中规模集成电路（MSI）逻辑器件如译码器、编码器、多路选择器、多路分配器、异或门、比较器、全加器、三态器件等作为设计的基本元素完成更为复杂的组合逻辑电路设计的方法。 制作：金燕华

P265 图5-50 74x148 8输入优先编码器 利用：A + A’·B = (A+A’)·(A+B) = A+B A2 = I7 + I6·I7’ + I5·I6’·I7’ + I4·I5’·I6’·I7’ = I7 + ( I6 + I5·I6’ + I4·I5’·I6’ )·I7’ = I7 + ( I6 + I5·I6’ + I4·I5’·I6’ ) = I7 + I6 + ( I5 + I4·I5’ )·I6’ = I7 + I6 + ( I5 + I4·I5’ ) = I7 + I6 + I5 + I4 制作：金燕华

A1 = I7+I6·I7’+ I3·I4’·I5’·I6’·I7’+ I2·I3’·I4’·I5’·I6’·I7’ 制作：金燕华

第五章 作业 5.8 5.9 5.12 5.15 5.16 5.19 (a)(c)(e) 5.21 5.22 5.24 5.28 5.36 5.37 5.40 5.45 5.46 5.78 5.79 5.82 5.85 5.89 制作：金燕华